generic: ar8216: reorder chip specific functions
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@ -404,6 +404,59 @@ ar8216_setup_port(struct ar8216_priv *priv, int port, u32 egress, u32 ingress,
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(pvid << AR8216_PORT_VLAN_DEFAULT_ID_S));
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(pvid << AR8216_PORT_VLAN_DEFAULT_ID_S));
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}
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}
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static int
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ar8216_hw_init(struct ar8216_priv *priv)
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{
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return 0;
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}
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static void
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ar8216_init_globals(struct ar8216_priv *priv)
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{
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/* standard atheros magic */
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priv->write(priv, 0x38, 0xc000050e);
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ar8216_rmw(priv, AR8216_REG_GLOBAL_CTRL,
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AR8216_GCTRL_MTU, 1518 + 8 + 2);
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}
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static void
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ar8216_init_port(struct ar8216_priv *priv, int port)
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{
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/* Enable port learning and tx */
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priv->write(priv, AR8216_REG_PORT_CTRL(port),
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AR8216_PORT_CTRL_LEARN |
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(4 << AR8216_PORT_CTRL_STATE_S));
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priv->write(priv, AR8216_REG_PORT_VLAN(port), 0);
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if (port == AR8216_PORT_CPU) {
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priv->write(priv, AR8216_REG_PORT_STATUS(port),
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AR8216_PORT_STATUS_LINK_UP |
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ar8xxx_has_gige(priv) ? AR8216_PORT_SPEED_1000M :
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AR8216_PORT_SPEED_100M |
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AR8216_PORT_STATUS_TXMAC |
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AR8216_PORT_STATUS_RXMAC |
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((priv->chip_type == AR8316) ? AR8216_PORT_STATUS_RXFLOW : 0) |
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((priv->chip_type == AR8316) ? AR8216_PORT_STATUS_TXFLOW : 0) |
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AR8216_PORT_STATUS_DUPLEX);
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} else {
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priv->write(priv, AR8216_REG_PORT_STATUS(port),
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AR8216_PORT_STATUS_LINK_AUTO);
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}
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}
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static const struct ar8xxx_chip ar8216_chip = {
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.hw_init = ar8216_hw_init,
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.init_globals = ar8216_init_globals,
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.init_port = ar8216_init_port,
|
||||||
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.setup_port = ar8216_setup_port,
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||||||
|
.read_port_status = ar8216_read_port_status,
|
||||||
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.atu_flush = ar8216_atu_flush,
|
||||||
|
.vtu_flush = ar8216_vtu_flush,
|
||||||
|
.vtu_load_vlan = ar8216_vtu_load_vlan,
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||||||
|
};
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static void
|
static void
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||||||
ar8236_setup_port(struct ar8216_priv *priv, int port, u32 egress, u32 ingress,
|
ar8236_setup_port(struct ar8216_priv *priv, int port, u32 egress, u32 ingress,
|
||||||
u32 members, u32 pvid)
|
u32 members, u32 pvid)
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||||||
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@ -427,12 +480,6 @@ ar8236_setup_port(struct ar8216_priv *priv, int port, u32 egress, u32 ingress,
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||||||
(members << AR8236_PORT_VLAN2_MEMBER_S));
|
(members << AR8236_PORT_VLAN2_MEMBER_S));
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}
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}
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static int
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||||||
ar8216_hw_init(struct ar8216_priv *priv)
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||||||
{
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return 0;
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}
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static int
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static int
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||||||
ar8236_hw_init(struct ar8216_priv *priv)
|
ar8236_hw_init(struct ar8216_priv *priv)
|
||||||
{
|
{
|
||||||
|
@ -456,6 +503,25 @@ ar8236_hw_init(struct ar8216_priv *priv)
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||||||
return 0;
|
return 0;
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}
|
}
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static void
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ar8236_init_globals(struct ar8216_priv *priv)
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{
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/* enable jumbo frames */
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ar8216_rmw(priv, AR8216_REG_GLOBAL_CTRL,
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AR8316_GCTRL_MTU, 9018 + 8 + 2);
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}
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static const struct ar8xxx_chip ar8236_chip = {
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.hw_init = ar8236_hw_init,
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||||||
|
.init_globals = ar8236_init_globals,
|
||||||
|
.init_port = ar8216_init_port,
|
||||||
|
.setup_port = ar8236_setup_port,
|
||||||
|
.read_port_status = ar8216_read_port_status,
|
||||||
|
.atu_flush = ar8216_atu_flush,
|
||||||
|
.vtu_flush = ar8216_vtu_flush,
|
||||||
|
.vtu_load_vlan = ar8216_vtu_load_vlan,
|
||||||
|
};
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||||||
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||||||
static int
|
static int
|
||||||
ar8316_hw_init(struct ar8216_priv *priv)
|
ar8316_hw_init(struct ar8216_priv *priv)
|
||||||
{
|
{
|
||||||
|
@ -516,24 +582,6 @@ out:
|
||||||
return 0;
|
return 0;
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}
|
}
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static void
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||||||
ar8216_init_globals(struct ar8216_priv *priv)
|
|
||||||
{
|
|
||||||
/* standard atheros magic */
|
|
||||||
priv->write(priv, 0x38, 0xc000050e);
|
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||||||
|
|
||||||
ar8216_rmw(priv, AR8216_REG_GLOBAL_CTRL,
|
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||||||
AR8216_GCTRL_MTU, 1518 + 8 + 2);
|
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||||||
}
|
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||||||
static void
|
|
||||||
ar8236_init_globals(struct ar8216_priv *priv)
|
|
||||||
{
|
|
||||||
/* enable jumbo frames */
|
|
||||||
ar8216_rmw(priv, AR8216_REG_GLOBAL_CTRL,
|
|
||||||
AR8316_GCTRL_MTU, 9018 + 8 + 2);
|
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||||||
}
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||||||
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||||||
static void
|
static void
|
||||||
ar8316_init_globals(struct ar8216_priv *priv)
|
ar8316_init_globals(struct ar8216_priv *priv)
|
||||||
{
|
{
|
||||||
|
@ -548,54 +596,6 @@ ar8316_init_globals(struct ar8216_priv *priv)
|
||||||
AR8316_GCTRL_MTU, 9018 + 8 + 2);
|
AR8316_GCTRL_MTU, 9018 + 8 + 2);
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}
|
}
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static void
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||||||
ar8216_init_port(struct ar8216_priv *priv, int port)
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{
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||||||
/* Enable port learning and tx */
|
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||||||
priv->write(priv, AR8216_REG_PORT_CTRL(port),
|
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AR8216_PORT_CTRL_LEARN |
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(4 << AR8216_PORT_CTRL_STATE_S));
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priv->write(priv, AR8216_REG_PORT_VLAN(port), 0);
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if (port == AR8216_PORT_CPU) {
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priv->write(priv, AR8216_REG_PORT_STATUS(port),
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AR8216_PORT_STATUS_LINK_UP |
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ar8xxx_has_gige(priv) ? AR8216_PORT_SPEED_1000M :
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AR8216_PORT_SPEED_100M |
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AR8216_PORT_STATUS_TXMAC |
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AR8216_PORT_STATUS_RXMAC |
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((priv->chip_type == AR8316) ? AR8216_PORT_STATUS_RXFLOW : 0) |
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((priv->chip_type == AR8316) ? AR8216_PORT_STATUS_TXFLOW : 0) |
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AR8216_PORT_STATUS_DUPLEX);
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||||||
} else {
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||||||
priv->write(priv, AR8216_REG_PORT_STATUS(port),
|
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||||||
AR8216_PORT_STATUS_LINK_AUTO);
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||||||
}
|
|
||||||
}
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static const struct ar8xxx_chip ar8216_chip = {
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.hw_init = ar8216_hw_init,
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||||||
.init_globals = ar8216_init_globals,
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||||||
.init_port = ar8216_init_port,
|
|
||||||
.setup_port = ar8216_setup_port,
|
|
||||||
.read_port_status = ar8216_read_port_status,
|
|
||||||
.atu_flush = ar8216_atu_flush,
|
|
||||||
.vtu_flush = ar8216_vtu_flush,
|
|
||||||
.vtu_load_vlan = ar8216_vtu_load_vlan,
|
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||||||
};
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||||||
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static const struct ar8xxx_chip ar8236_chip = {
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.hw_init = ar8236_hw_init,
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||||||
.init_globals = ar8236_init_globals,
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||||||
.init_port = ar8216_init_port,
|
|
||||||
.setup_port = ar8236_setup_port,
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|
||||||
.read_port_status = ar8216_read_port_status,
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||||||
.atu_flush = ar8216_atu_flush,
|
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||||||
.vtu_flush = ar8216_vtu_flush,
|
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||||||
.vtu_load_vlan = ar8216_vtu_load_vlan,
|
|
||||||
};
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||||||
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||||||
static const struct ar8xxx_chip ar8316_chip = {
|
static const struct ar8xxx_chip ar8316_chip = {
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||||||
.caps = AR8XXX_CAP_GIGE,
|
.caps = AR8XXX_CAP_GIGE,
|
||||||
.hw_init = ar8316_hw_init,
|
.hw_init = ar8316_hw_init,
|
||||||
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